FPGA（Field Programmable Gate Array）芯片基于可編程器件（PAL、GAL）發(fā)展而來(lái)，是半定制化、可編程的集成電路。FPGA芯片按固定模式處理信號(hào)，可執(zhí)行新型任務(wù)（計(jì)算任務(wù)、通信任務(wù)等）。FPGA芯片相對(duì)專用集成電路（如ASIC芯片）更具靈活性，相對(duì)傳統(tǒng)可編程器件可添加更大規(guī)模電路數(shù)量以實(shí)現(xiàn)多元功能。

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1.FPGA芯片相較于CPU芯片

CPU架構(gòu)：CPU用于處理視覺算法需按指定順序執(zhí)行指令，第指令在圖像整體運(yùn)行完成后，第二指令開始運(yùn)行。在4步操作指令環(huán)境下，設(shè)定單個(gè)操作指令運(yùn)行需10毫秒，完成總算法耗時(shí)約40毫秒。

FPGA架構(gòu)：FPGA用于處理視覺算法采取規(guī)模化并行運(yùn)算模式，可于圖像不同像素內(nèi)同時(shí)運(yùn)行4步操作指令。設(shè)定單個(gè)操作操作指令運(yùn)行需10毫秒，F(xiàn)PGA完成圖像整體視覺算法處理時(shí)間僅為10毫秒，F(xiàn)PGA圖像處理速度顯著快于CPU。

“FPGA+CPU”架構(gòu)：此架構(gòu)下，圖像在CPU與FPGA之間傳輸，包含傳輸時(shí)間在內(nèi)的算法整體處理時(shí)間仍低于純CPU架構(gòu)。

2.FPGA芯片相較于GPU芯片

峰值性：GPU計(jì)算峰值（10Tflops）顯著高于FPGA計(jì)算峰值（小于1TFlops）。GPU架構(gòu)依托深度流水線等技術(shù)可基于標(biāo)準(zhǔn)單元庫(kù)實(shí)現(xiàn)手工電路定制。相對(duì)而言，F(xiàn)PGA設(shè)計(jì)資源受限，型號(hào)選擇決定邏輯資源上限（浮點(diǎn)運(yùn)算資源占用較高），F(xiàn)PGA邏輯單元基于SRAM查找表，布線資源受限。

內(nèi)存接口：GPU內(nèi)存接口（雙倍數(shù)據(jù)傳輸率存儲(chǔ)器等）帶寬優(yōu)于FPGA使用的DDR（雙倍速率同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器）接口，滿足機(jī)器學(xué)習(xí)頻繁訪問內(nèi)存需求。

靈活性：FPGA可根據(jù)特定應(yīng)用編程硬件，GPU設(shè)計(jì)完成后無(wú)法改動(dòng)硬件資源，遠(yuǎn)期機(jī)器學(xué)習(xí)使用多條指令平行處理單數(shù)據(jù)，F(xiàn)PGA硬件資源靈活性更能滿足需求。

功耗：GPU平均功耗（200W）遠(yuǎn)高于FPGA平均功耗（10W），可有效解決散熱問題。

3.FPGA芯片相較于ASIC芯片

ASIC需從標(biāo)準(zhǔn)單元進(jìn)行設(shè)計(jì)，功能需求及性能需求發(fā)生變化時(shí)，ASIC芯片設(shè)計(jì)需經(jīng)歷重新投片，設(shè)計(jì)流程時(shí)間成本、經(jīng)濟(jì)成本較高。

FPGA包括預(yù)制門和觸發(fā)器，具備可編程互聯(lián)特性，可實(shí)現(xiàn)芯片功能重新配置。相對(duì)而言，ASIC芯片較少具備重配置功能。

ASIC與FPGA經(jīng)濟(jì)成本、時(shí)間成本區(qū)別：ASIC設(shè)計(jì)過程涉及固定成本，設(shè)計(jì)過程造成材料浪費(fèi)較少，相對(duì)FPGA重復(fù)成本較低，非重復(fù)成本較高（平均超百萬(wàn)美元）。

FPGA重復(fù)成本高于同類ASIC芯片，規(guī)模化量產(chǎn)場(chǎng)景下，ASIC芯片單位IC成本隨產(chǎn)量增加持續(xù)走低，總成本顯著低于FPGA芯片。

FPGA無(wú)需等待芯片流片周期，編程后可直接使用，相對(duì)ASIC有助于企業(yè)節(jié)省產(chǎn)品上市時(shí)間。

技術(shù)未成熟階段，F(xiàn)PGA架構(gòu)支持靈活改變芯片功能，有助于降低器件產(chǎn)品成本及風(fēng)險(xiǎn)，更適用于5G商用初期的市場(chǎng)環(huán)境。

公司介紹

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